社区版Dify 调用不了局域网(172.18.0.0网段)内API，ping不到局域网(172.18.0.0网段)

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4通道12bit位宽的DA芯片AD5724 Verilog驱动源码+芯片技术手册:odule ad5724_ctrl #(parameter DATA_WIDTH = 12,parameter RANG_WIDTH = 16)(input wire clk , //这里的时钟频率为50M，如果降低时钟频率请同步降低触发周期i_trig // 提高频率需要代码中o_da5724_sclk的周期input wire rst_n , input wire i_trig , //DA输出数据更新触发信号，在50M时钟频率下可以设置为5us input wire [DATA_WIDTH - 1 : 0] i_ch1_data ,input wire [DATA_WIDTH - 1 : 0] i_ch2_data ,input wire [DATA_WIDTH - 1 : 0] i_ch3_data ,input wire [DATA_WIDTH - 1 : 0] i_ch4_data ,input wire [RANG_WIDTH - 1 : 0] i_out_range , //设置为16'd4 表示输出正负10Vinput wire i_ad_en ,input wire i_da5724_sdout ,output wire o_da5724_sclk ,output wire o_da5724_sdin ,output wire o_da5724_sync_n ,output wire o_da5724_ldac_n ,output wire o_da5724_clr_n);localparam POWER_CFG_REF = 24'h10000f ;localparam DV_RANG_CFG_REF = 8'h0c ;localparam CH_A_REF = 8'h00 ;localparam CH_B_REF = 8'h01 ;localparam CH_C_REF = 8'h02 ;localparam CH_D_REF = 8'h03 ;localparam CH_NUM_WIDTH = 2 ;localparam CFG_NUM_WIDTH = 3 ;localparam WAIT_CNT_WIDTH = 4 ;localparam DAC_DATA_WIDTH = 16 ;localparam REG_DATA_WIDTH = 24 ;localparam TRAN_CNT_WIDTH = 5 ;localparam CTRL_ST_WIDTH = 10 ;localparam IDLE = 10'b0000000001 , INIT_PWR = 10'b0000000010 , TRANS_OP_HIGH = 10'b0000000100 , TRANS_OP_LOW = 10'b0000001000 , LDAC_SET = 10'b00000100

虚拟仪器课程设计报告

参考文献：[1]乔珊. 主动配电网多源协同运行优化研究[D]. 山东大学, 2021. [2]高红均,刘俊勇,沈晓东,等. 主动配电网最优潮流研究及其应用实例 [J]. 中国电机工程学报, 2017, 37 (06): 1634-1645. DOI:10.13334/j.0258-8013.pcsee.152839.        主动配电网技术的发展已成为大势所趋，如何协调主动配电网中的各元件进行协同和优化，使可再生能源充分被消纳，是亟待解决的问题。本文针对主动配电网中的主要组成部分，包括分布式电源、储能系统、电动汽车、无功补偿装置等，分析其出力特性及可调潜力，对其进行数学建模，从保障配电网安全稳定运行角度出发，尽量降低运行成本，构建多时间尺度优化调度模型。在优化调度过程中，在满足经济效益最优的同时实现对分布式电源出力的最大化消纳，尽量缩减潮流分布的峰谷差，实现“源”、“荷”、“储”的多方面协同优化运行。